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输入要查询的单词：
multiply and accumulate
网络释义
累加运算
FPGA和可编程信号处理器 位定点数、或者是32位浮点数）和一个扩展字宽的累加器构成。PDSP的优势源于大多数信号处理算法的乘-累加运算（multiply and accumulate，MAC）都是非常密集的。通过多级流水 线架构，PDSP可以获得仅受阵列乘法器的速度限制的MAC速度。由此可以
乘法与累加计算
智能传感器讯号处理的需求分析 - 资讯频道 - RFID中国网 的16位×16位乘法运算的结果。 大多数DSP算法如FIR和IIR滤波，都会涉及计算乘积之和。利用特殊指令如乘法与累加计算(Multiply-and-Accumulate, MAC)，可以在一个运算速度内将两个16位数字元相乘，将结果加到累加器，然后从随机存取内存(RAM)预先取得
常用短语
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