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bus clock

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总线计时器

网络释义

总线时钟

Bus Clock（总线时钟）: p0 q/ @* A( S9 |9 v4 Q- ~2 a4 H% w

总线计时器

... bus circuit 总线电路 bus clock 总线计时器 bus compartment 母线室; 汇流条隔离室 ...

总线频率

内存频率：分为核心频率(Internal rate)和I/O总线频率(Bus clock)。每条内存都是由内存芯片组成，内存芯片的频率就是核心频率。

常用短语

Bus Clock Rate总线时钟频率；总线电路
BCLK Bus CLocK总线时钟；总线定时
CBUS-CLK Control Bus Clock控制总线时钟
Bus Clock Frequency总线时钟频率
VBusClk Voltage Bus Clock总线时钟信号
serial bus clock串行时钟总线
Bus Wait Clock总线等待时钟

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